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Minimizing and Exploiting Leakage in VLSI Design

Sprache EnglischEnglisch
Buch Broschur
Buch Minimizing and Exploiting Leakage in VLSI Design Rajesh Garg
Libristo-Code: 09161813
Verlag Springer-Verlag New York Inc., November 2014
This book presents two techniques to reduce leakage power in digital VLSI ICs. The first reduces lea... Vollständige Beschreibung
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This book presents two techniques to reduce leakage power in digital VLSI ICs. The first reduces leakage through the selective use of high threshold voltage sleep transistors, while the second by applying the optimal Reverse Body Bias voltage.§

Informationen zum Buch

Vollständiger Name Minimizing and Exploiting Leakage in VLSI Design
Autor Rajesh Garg
Sprache Englisch
Einband Buch - Broschur
Datum der Veröffentlichung 2014
Anzahl der Seiten 214
EAN 9781489985293
ISBN 9781489985293
Libristo-Code 09161813
Verlag Springer-Verlag New York Inc.
Gewicht 379
Abmessungen 155 x 13 x 235

Kategorie

Technologie, Ingenieurswissenschaft, Landwirtschaft, Industrieprozesse > Elektronik, Nachrichtentechnik > Elektronik > Schaltkreise und Komponenten (Bauteile)
Technologie, Ingenieurswissenschaft, Landwirtschaft, Industrieprozesse > Technologie, allgemein > Ingenieurswesen, Maschinenbau allgemein
EDV und Informationstechnologie > Grafische und digitale Media-Anwendungen > Computer-Aided Design (CAD)
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